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Qphy-ddr2

Die Teledyne LeCroy QPHY-DDR2-Testlösung ist die beste Methode zur Charakterisierung von DDR2-Speicherschnittstellen. QPHY-DDR400 kann Messungen auf 533 MHz, 667 MHz, 800 MHz, 1066 MHz, 2 MHz und benutzerdefinierten Geschwindigkeitsstufen durchführen und verfügt über eine vollständige Suite von Takt-, Elektro- und Timing-Tests, wie in der JEDEC-Spezifikation und den Ergänzungen zu Intel JEDEC-Spezifikationen angegeben.

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Merkmale

 

  • Unterstützung für das Testen von 400 MHz, 533 MHz, 667 MHz, 800 MHz, 1066 MHz und benutzerdefinierten Geschwindigkeitsstufen von DDR2-Signalen
  • Der schnellste Weg, um Vertrauen in Ihre DDR2-Schnittstelle zu gewinnen, indem Sie eine große Anzahl von Zyklen messen und statistische Ergebnisse melden
  • Vollkommen kommentierter Screenshot der Worst-Case-Messung, der erfasst und im Bericht angezeigt wird, einschließlich Spurenbezeichnungen und zugehöriger Spannungspegel
  • Die Funktion „Stopp bei Test/Fehler“ ermöglicht es dem Benutzer, bei einem bestimmten Test anzuhalten und die Messung auf der Oszilloskopanzeige zu überprüfen
  • Vollständige Testabdeckung für Tests wie in den JEDEC-Spezifikationen JESD79-2E und JESD208 und Intel DDR2 667/800 JEDEC Specifications Addendum Rev. 1.1 und Intel DDR2 400/533 JEDEC Specifications Addendum Rev. 1.0 beschrieben

Die Teledyne LeCroy QPHY-DDR2-Testlösung ist die beste Methode zur Charakterisierung von DDR2-Speicherschnittstellen. QPHY-DDR400 kann Messungen auf 533 MHz, 667 MHz, 800 MHz, 1066 MHz, 2 MHz und benutzerdefinierten Geschwindigkeitsstufen durchführen und verfügt über eine vollständige Suite von Takt-, Elektro- und Timing-Tests, wie in der JEDEC-Spezifikation und den Ergänzungen zu Intel JEDEC-Spezifikationen angegeben.

Die QualiPHY-Plattform von Teledyne LeCroy bietet eine einfach zu konfigurierende Benutzeroberfläche, ermöglicht eine benutzerdefinierte Test- und Grenzwertauswahl, zeigt dem Benutzer Verbindungsdiagramme an, um eine ordnungsgemäße Konnektivität sicherzustellen, und erstellt Berichte mit allen Ergebnissen, einschließlich Screenshots der schlimmsten Ausfälle für jeden zutreffenden Fall Prüfung. Darüber hinaus können alle von QPHY-DDR2 getesteten Wellenformen gespeichert werden, um Informationen einfach auszutauschen oder die Tests zu einem späteren Zeitpunkt erneut auszuführen.

QPHY-DDR2 ermöglicht es dem Benutzer, das höchste Maß an Vertrauen in seine DDR2-Schnittstelle zu erlangen. Aufgrund der hohen Variabilität bei DDR2-Messungen ist es wichtig, eine große Anzahl von Zyklen zu messen. Durch die Messung einer großen Anzahl von Zyklen in sehr kurzer Zeit kann der Benutzer sicherer sein, dass er die wahren maximalen und minimalen Punkte für seine Messung erfasst.

Zusätzlich zur automatisierten Charakterisierung von DDR2-Signalen ermöglicht QPHY-DDR2 auch leistungsstarke Debug-Funktionen für DDR2-Signale innerhalb des Oszilloskops. Fehlerursachen können schnell und einfach mit allen erweiterten seriellen Datentools im Oszilloskop gefunden werden. Dazu gehören: SDA II, Eye Doctor™ II, WaveScan™ und viele mehr.

Takttests – Diese Tests führen alle Takttests durch, wie in der entsprechenden JEDEC-Spezifikation beschrieben. Diese umfassen durchschnittliche Taktperiode, absolute Taktperiode, durchschnittliche hohe/niedrige Impulsbreite, absolute hohe/niedrige Impulsbreite, Halbperioden-Jitter, Taktperioden-Jitter, Zyklus-zu-Zyklus-Perioden-Jitter und kumulativer Fehler über n-Perioden-Tests.

Elektrische Tests – Diese Tests messen die elektrischen Eigenschaften der DDR2-Signale. Der oben gezeigte SoutR-Test misst die Anstiegsgeschwindigkeiten der Daten-, Strobe- und Taktsignale. Es wurden über 1000 Slew-Rate-Messungen durchgeführt und der schlechteste Fall wurde auf dem Bildschirm angezeigt. Die Signale sind mit den Signalnamen kommentiert, um den Bildschirm leicht interpretierbar zu machen. Zusätzlich werden Cursor verwendet, um dem Benutzer die Spannungspegel anzuzeigen, zwischen denen die Anstiegsgeschwindigkeit gemessen wurde.

Timing-Test – Diese Tests überprüfen die zeitliche Beziehung zwischen bestimmten DDR2-Ereignissen. Wie oben gezeigt, verifiziert der tDQSCK-Test, dass die Strobe-Ausgangszugriffszeit vom Taktsignal innerhalb der von der entsprechenden JEDEC-Spezifikation festgelegten Grenze liegt. In diesem Test wurden 5000 tDQSCK-Messungen an allen DDR2-Lesebursts durchgeführt und die schlechteste Instanz wurde auf dem Bildschirm angezeigt.

Augendiagramme – Augendiagramme sind ein leistungsstarkes Werkzeug zum Debuggen serieller Datensignale. QPHY-DDR2 ermöglicht es dem Benutzer, Augendiagramme sowohl der Lese- als auch der Schreibdaten-Bursts zu erstellen, um sicherzustellen, dass die Signalintegrität ausreichend ist, damit die Daten vom Empfänger ordnungsgemäß abgetastet werden.

QualiPHY verfügt über viele voreingestellte Compliance-Konfigurationen, ermöglicht es Benutzern jedoch auch, ihre eigenen Konfigurationen und Grenzwertsätze zu erstellen.

Verbindungsdiagramme fordern den Benutzer auf, die erforderlichen Verbindungen herzustellen.

Konformitätsberichte enthalten alle getesteten Werte, die spezifischen Testgrenzen und Screenshots. Compliance-Berichte können als HTML, PDF oder XML erstellt werden.

QualiPHY

QualiPHY wurde entwickelt, um die Zeit, den Aufwand und das Fachwissen zu reduzieren, die für die Durchführung von Konformitätstests auf seriellen Hochgeschwindigkeitsbussen erforderlich sind.

  • Führt den Benutzer durch jeden Testaufbau
  • Führt jede Messung gemäß dem entsprechenden Testverfahren durch
  • Vergleicht jeden gemessenen Wert mit den geltenden Spezifikationsgrenzen
  • Vollständige Dokumentation aller Ergebnisse
  • QualiPHY hilft dem Benutzer, Tests auf die richtige Weise durchzuführen – jedes Mal!

 

Spezifikationen

Uhrentests
tCK(avg) – Durchschnittliche Taktperiode
tCH(avg) – Durchschnittliche hohe Impulsbreite
tCL(avg) – Durchschnittliche niedrige Impulsbreite
tCK (abs) – Absolute Taktperiode
tCH(abs) – Absolute High-Impulsbreite
tCL(abs) – Absolute niedrige Impulsbreite
tJIT(Duty) – Halbperioden-Jitter
tJIT(per) – Taktperioden-Jitter
tJIT(cc) – Zyklus-zu-Zyklus-Perioden-Jitter
tERR(n pro) – Kumulativer Fehler

Erweitertes Debuggen
Augendiagramm von Daten und Strobe auf Lesezyklus
Augendiagramm von Daten und Strobe auf Schreibzyklus

Elektrische Tests
SlewR – Eingangsanstiegsflankenanstiegsrate
SlewF – Anstiegsgeschwindigkeit der fallenden Flanke eingeben
VIH(ac) – AC-Eingangslogik hoch
VIH(dc) – DC-Eingangslogik hoch
VIL(ac) – AC-Eingangslogik niedrig
VIL(dc) – DC-Eingangslogik niedrig
VSWING – Maximales Eingangssignal
Peak-to-Peak-Swing
SoutR – Anstieg der Ausgangsanstiegsgeschwindigkeit
SoutF – Abfall der Flankensteilheit des Ausgangs
tSLMR – Ausgangs-Slew-Rate-Anpassungsverhältnis
AC-Überschwingungsspitzenamplitude
AC-Überschreitungsbereich über VDDQ
AC-Unterschwingungs-Spitzenamplitude
AC-Unterschreitungsbereich unter VSSQ
VID(ac) – AC-Differenzeingangsspannung
VIX(ac) – AC-Differential-Eingangskreuzungspunktspannung
VOX(ac) – Kreuzpunktspannung des AC-Differentialausgangs

Timing-Tests
tHZ(DQ) – DQ Hochimpedanzzeit von CK/CK#
tLZ(DQ) – DQ-Niederimpedanzzeit von CK/CK#
tLZ(DQS) – DQS-Niederimpedanzzeit von CK/CK#
tHP – CK halbe Impulsbreite
tQHS – DQ-Hold-Skew-Faktor
tQH – Haltezeit des DQ/DQS-Ausgangs von DQS
tDQSH – Hohe Impulsbreite des DQS-Eingangs
tDQSL – Niedrige Impulsbreite des DQS-Eingangs
tDSS – DQS Fallende Flanke zu CK Setup-Zeit
tDSH – DQS Haltezeit der fallenden Flanke von CK
tWPRE – Präambel schreiben
tWPST – Postambel schreiben
tRPRE – Präambel lesen
tRPST – Postambel lesen
tDQSQ – Versatz zwischen DQS und DQ
tDQSS – DQS Latching-Übergang zur Taktflanke
tDQSCK – DQS-Ausgangszugriffszeit von CK/CK#
tAC – DQ-Ausgangszugriffszeit von CK/CK#
tDS(base) – Setup-Zeit für DQ- und DM-Eingang
tDH(Basis) – DQ- und DM-Eingangshaltezeit
tIS(base) – Einrichtungszeit für Adresse und Steuereingang
tIH(base) – Adress- und Steuereingangshaltezeit
tDS1(Basis) – Setup-Zeit für DQ- und DM-Eingang (Single-Ended-Strobe)
tDH1 (Basis) – DQ- und DM-Eingangshaltezeit (Single-Ended-Strobe)